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ANALOG CIRCUIT DESIGN

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					       ANALOG CIRCUIT DESIGN
           FINAL PROJECT
               Due 6/22
This project is aimed to design a opamp with specifications as shown as
next
                               VDD




                   MPB                   MP




                         Vi+     MN1          MN2       Vi-



                                                         Vout

           Ibias                                         CL=1PF

                                 MN3          MN4



                                       GND



                    Technology                                Cic18 CMOS
                  Power Supply                                    1.8V
                     DC-Gain                                     >55dB
               unit Gain Bandwidth                              >50MHz
                  Phase Margin                                    >60°
                     Slew Rate                                 >100 V/μs
                        CL                                         1pF
               Output Swing Range                               0.5~1.5v
                      CMRR                                       >60dB
                       Power                                      1mW
記分方式:

上列規格盡量符合,符合越多項目,分數越高。

繳交方式:

盡量詳細說明如何設計 OP 的步驟(如何設計 OP 的尺寸及各個規格

的參數如 I, Gain 增益),並將模擬結果一起寫成一個 word 檔 檔名:

學號_系級_姓名。最後把 word 和.sp(原始檔,即不需增加任何指令

的檔案)、壓縮成:學號_系級_姓名.rar,在 6/22(星期一)晚上十二點前

傳至 ftp 上(在 WORD 檔最前面 請附像下列的表格)


         Technology       Cic18 CMOS   Your DESIGN
       Power Supply           1.8V
           DC-Gain           >55dB
    unit Gain Bandwidth     >50MHz
       Phase Margin           >60°
          Slew Rate        >100 V/μs

            CL                1pF
    Output Swing Range     0.5~1.5v
          CMRR              >60dB
           Power             1mW

				
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